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詳細書籍分類

Cadence Concept-HDL & Allegro原理圖與電路板設計(第2版)

( 簡體 字)
作者:周潤景,李茂泉類別:1. -> 電子工程 -> 電路設計 -> Cadence
譯者:
出版社:電子工業出版社Cadence  Concept-HDL & Allegro原理圖與電路板設計(第2版) 3dWoo書號: 54629
詢問書籍請說出此書號!

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NT定價: 640
折扣價: 602

出版日:6/1/2021
頁數:460
光碟數:0
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印刷:黑白印刷語系: ( 簡體 版 )
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ISBN:9787121412035
作者序 | 譯者序 | 前言 | 內容簡介 | 目錄 | 
(簡體書上所述之下載連結耗時費功, 恕不適用在台灣, 若讀者需要請自行嘗試, 恕不保證)
作者序:

譯者序:

前言:

Cadence SPB 17.4是Cadence公司新推出的功能強大的EDA開發工具包,它提供了從原理圖設計輸入、分析到PCB設計、PCB制造文件輸出等一整套工具。
Cadence提供兩個集成的、從前端到后端的設計解決方案,即由Concept HDL到Allegro,以及由Capture到Allegro,本書講述的是前者。而后者可參考相關書籍,如《Cadence高速電路設計與仿真》,可幫助讀者應對復雜的PCB設計,并用于先進的高速、約束驅動電路板的設計。
本書根據作者多年的工作經驗,以具體的電路為例,系統地介紹了Concept HDL和Allegro在原理圖和PCB設計中的方法。本書分為22章和1個附錄,主要介紹項目管理器、Concept HDL原理圖設計工具、約束管理器、工程變更、設計重用、焊盤制作、元件封裝的制作、電路板的建立、敷銅、差分對、Allegro PCB設計工具和SPECCTRA布線工具的功能與設計技巧、添加測試點、Allegro其他高級功能。本書提供書中涉及的實例和技術文件,以方便讀者更好地理解和掌握所學的內容,使讀者對設計工具有較為深入的理解,并基本掌握從原理圖設計到PCB設計等一系列設計步驟的實現方法和技巧。
本書特點:
1.全面。詳細講解基于Concept HDL和Allegro設計電路板的全過程。
2.實用。書中選擇的例子典型,既能全面展示軟件具有的功能,又使讀者學習起來非常方便,難度適中。
3.專業。本書已被列為Cadence SPB軟件用戶的技術培訓教材。
本書由周潤景、李茂泉編著。其中,李茂泉編寫第1章和第2章,周敬和張紅敏編寫第21章和第22章,其余由周潤景編寫;全書由周潤景統稿、定稿。
為便于讀者閱讀、學習,特提供本書所講實例下載資源,請訪問華信教育資源網下載。
由于Cadence公司的PCB工具性能非常強大,不可能通過一本書完成全部內容的詳盡介紹,加上時間與水平有限,不妥之處還望指正。
編著者
內容簡介:

本書以Cadence SPB 17.4 PCB開發軟件為平臺,以具體電路為范例,詳盡講解基于Concept-HDL到Allegro電路板設計的全過程,包括項目管理、元器件原理圖符號及元器件封裝創建、原理圖設計(Concept-HDL)、設計約束、PCB布局與布線的規則、CAM文件輸出等電路板設計的全過程,對PCB板級設計有全面的參考和學習價值。
目錄:

第1章 概述
1.1 功能特點
1.2 設計流程
1.3 Cadence Allegro SPB 新功能介紹
1.4 進入HDL設計界面
1.5 Allegro PCB Editor入門
第2章 項目相關設置
第3章 進入設計和打包
3.1 放置元件
3.2 連接電路圖
3.3 打包(Packaging)簡介
3.4 添加電容器
3.5 創建附加頁
3.6 其他指令的使用
3.7 運行規則檢驗(Rules Checker)
3.8 交叉標注(Cross Reference)
3.9 打印原理圖
第4章 層次圖和組的設計
4.1 創建層次圖
4.2 查看DAAMP設計
4.3 團隊設計(Team Design)
4.4 DATA設計的創建
4.5 ROOT設計的創建
4.6 層次圖的打包
4.7 交叉標注和層次圖繪制
4.8 元件清單報告(Bill of Materials)
4.9 運行電子規則檢測
4.10 創建網表報告
4.11 多樣性設計(Variant)
第5章 設計規則的預設置
5.1 電氣規則設置
5.2 差分對(Differential Pairs)
5.3 相對傳輸延遲
5.4 網絡類(Net Classes)
5.5 附加元件屬性
第6章 規則驅動布局
6.1 加載網表
6.2 元件的布局
6.3 信號走線
6.4 重命名參考標識符
6.5 回注(Back Annotation)
6.6 項目存檔(Archiving a Project)
第7章 工程變更
7.1 復制原有項目
7.2 修改原理圖
7.3 重新打包原理圖
7.4 同步設計
7.5 編輯PCB布線
7.6 使用PCB的約束管理器
第8章 設計重用
8.1 調用已創建的工程
8.2 案例研究:概述
8.3 案例分析:相對傳輸延遲規則
8.4 案例分析:差分對規則
8.5 案例分析:約束范圍
第9章 PCB基礎及用戶界面
9.1 PCB基礎知識
9.1.1 PCB的材料
9.1.2 PCB的結構
9.1.3 PCB的制造流程
9.1.4 Cadence在PCB設計中的作用及優勢
9.1.5 PCB設計和電磁兼容
9.1.6 PCB設計常用術語
9.2 Allegro PCB編輯器向導
9.3 PCB編輯器用戶界面的操作
9.4 用腳本文件控制可視及顏色
9.5 著色和使用查找過濾器
9.6 顯示元件指令的查找過濾器
第10章 焊盤制作
10.1 基本概念
10.2 創建Flash Symbol
10.3 創建焊盤過孔
10.4 貼片焊盤的制作
第11章 元件封裝的制作
11.1 封裝符號基本類型
11.2 利用向導制作DIP16的封裝
11.3 手工制作DIP14的封裝
11.4 手工制作SOIC16的封裝
11.5 邊緣連接器(Edge Connector)的制作
11.6 分立元件(DISCRETE)封裝的制作
11.6.1 貼片的分立元件封裝的制作
11.6.2 直插的分立元件封裝的制作
11.6.3 自定義焊盤封裝制作
第12章 電路板的建立
12.1 建立電路板機械符號
12.2 創建主設計文件(.brd)
12.3 從Design Entry HDL進入PCB Editor
12.4 從Design Entry CIS進入PCB Editor
12.5 從第三方導入網絡表
第13章 設定設計約束
13.1 物理規則設置
13.2 間距規則設置
13.3 設置組間規則
13.4 設置屬性
13.5 設置約束管理器
13.6 在指定線路上布線
13.7 設置擴展設計規則
13.8 擴展設計規則的自動布線
第14章 元件布局
14.1 布局規劃
14.2 分配元件序號
14.3 手工擺放元件
14.4 快速擺放并復制電路
第15章 高級布局
15.1 顯示飛線
15.2 交換
15.3 基于ALT_SYMBOL屬性的高級布線
15.4 按原理圖頁手動布局
15.5 對DE CIS原理圖手動布局
15.6 使用PCB Router自動布局
第16章 敷銅
16.1 基本概念
16.2 敷銅區域
16.3 分割平面
16.4 用添加多邊形的方法分割平面
16.5 分割復雜平面(Complex Planes)
16.6 添加負平面Shape并進行負平面孤銅檢查
第17章 布線及優化
17.1 布線的基本原則
17.2 定義柵格
17.3 添加和刪除連接線與過孔
17.4 自動布線的準備工作
17.5 運行PCB Router
17.6 檢查未連接的引腳
17.7 改善布線連接
17.8 替換布線并使用Cut選項修改線路
17.9 優化布線(Gloss)
17.10 添加和刪除淚滴
17.11 移除動態焊盤
17.12 自定義平滑布線
17.13 交互式布線
17.14 為線路更改顏色
17.15 查看分離電壓引腳
17.16 控制并編輯布線長度
17.17 高速網絡布線
第18章 后處理
18.1 重命名元件序號
18.2 文字面調整
18.3 回注(Backannotation)
第19章 加工PCB前的準備工作
19.1 創建絲印層
19.2 建立報告
19.3 建立Artwork文件
19.4 瀏覽Gerber文件和加載Artwork文件
19.5 創建鉆孔圖
19.6 建立鉆孔文件
19.7 輸出底片文件
19.8 建立結構圖和裝配圖
19.9 建立NCDRILL文件
19.10 在CAM350中檢查Gerber文件
19.10.1 CAM350用戶界面介紹
19.10.2 CAM350的快捷鍵及D碼
19.10.3 CAM350中Gerber文件的導入
第20章 差分對
20.1 設置差分對(Differential Pair)
20.2 差分對布線
第21章 添加測試點
21.1 準備測試
21.2 修改測試點
第22章 Allegro其他高級功能
22.1 設置過孔的焊盤
22.2 更新元件封裝符號
22.3 Net和Xnet
22.4 使用技術文件
22.5 設計重用
22.6 DFA檢查
22.7 修改env文件
22.8 數據庫寫保護
附錄A 參考原理圖
序: